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一种基于多板卡互联的数据处理单元芯片原型验证方法及装置

申请号: CN202311264279.X
申请人: 中科驭数(北京)科技有限公司
申请日期: 2023/9/27

摘要文本

本发明提供一种基于多板卡互联的数据处理单元芯片原型验证方法及装置,包括:在单块FPGA板卡中,将多路数据处理单元逻辑的数据流转换为总线互联IP支持的多路标准总线数据流;对多路标准总线数据流进行仲裁编码,合并得到单路标准总线数据流;将单路标准总线数据流发送至高速串行数据传输接口,以进行板间通信;接收其他FPGA板卡发送的单路标准总线数据流,并对单路标准总线数据流进行译码,分解得到多路标准总线数据流;将多路标准总线数据流转换为多路数据处理单元逻辑的数据流,发送至相应的目的逻辑模块。本发明提供的方法使用FPGA自带的总线互联IP和高速串行总线IP,实现了基于多颗FPGA芯片的DPU芯片原型验证,性能高且成本低。

专利详细信息

项目 内容
专利名称 一种基于多板卡互联的数据处理单元芯片原型验证方法及装置
专利类型 发明申请
申请号 CN202311264279.X
申请日 2023/9/27
公告号 CN117421164A
公开日 2024/1/19
IPC主分类号 G06F11/22
权利人 中科驭数(北京)科技有限公司
发明人 马伟硕
地址 北京市海淀区北清路81号院一区4号楼14层1401室

专利主权项内容

1.一种基于多板卡互联的数据处理单元芯片原型验证方法,其特征在于,所述方法在多块现场可编程门阵列板卡中执行,包括以下步骤:在单块现场可编程门阵列板卡中,将现场可编程门阵列芯片中多路数据处理单元逻辑形式的数据流转换为总线互联协议支持的多路第一标准总线数据流;对所述第一标准总线数据流进行仲裁编码,合并得到单路第一标准总线数据流;将所述第一标准总线数据流发送至用于连接不同现场可编程门阵列板卡的高速串行数据传输接口;接收其他现场可编程门阵列板卡发送的单路第二标准总线数据流,并对所述第二标准总线数据流进行译码,分解得到多路第二标准总线数据流;将所述第二标准总线数据流转换为多路数据处理单元逻辑形式的数据流,发送至相应的目的逻辑模块;在多块现场可编程门阵列板卡间,利用所述高速串行数据传输接口进行数据传输,实现板间通信。