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一种低速CPU核间偶数末位电平补偿系统和补偿方法
摘要文本
本发明提供一种低速CPU核间偶数末位电平补偿系统和补偿方法，系统包括：末位偶数判断器、末位标志寄存器，缓存模块及偶数分解模块；末位偶数判断器包括末位判断器、偶数判断器；末位判断器用于判断时序电路中止时获取的串行数据线数据是否为末位；偶数判断器用于判断末位预定数量二进制数对应的十进制数是否为偶数；偶数分解模块用于在判定所述十进制数为偶数时，根据偶数分解表，将偶数拆解为预定数量奇质数之和；并将预定数量奇质数转化为对应的预定数量二进制数；缓存模块用于将二进制数进行缓存；末位标志寄存器用于存储末位判断结果、偶数判断结果及所述偶数的拆解位数。本发明能够解决CPU核间传输时出现的末位结束位电平漂移问题。
申请人信息
- 申请人:中金金融认证中心有限公司
- 申请人地址:100054 北京市西城区菜市口南大街平原里20号楼1-7 1-9 1-10
- 发明人: 中金金融认证中心有限公司
专利详细信息
| 项目 | 内容 |
|---|---|
| 专利名称 | 一种低速CPU核间偶数末位电平补偿系统和补偿方法 |
| 专利类型 | 发明申请 |
| 申请号 | CN202311567450.4 |
| 申请日 | 2023/11/22 |
| 公告号 | CN117743242A |
| 公开日 | 2024/3/22 |
| IPC主分类号 | G06F13/42 |
| 权利人 | 中金金融认证中心有限公司 |
| 发明人 | 马瑶瑶; 杜壮昌; 袁桂芬; 姚寅峰; 夏立宁; 王波; 姚乾; 石宗育; 沈敏鑫; 王宏铭; 宋鑫磊; 郭哲; 曹博远; 张大健 |
| 地址 | 北京市西城区菜市口南大街平原里20号楼1-71-91-10 |
专利主权项内容
1.一种低速CPU核间偶数末位电平补偿系统，其特征在于，包括：末位偶数判断器、末位标志寄存器，缓存模块及偶数分解模块；所述末位偶数判断器包括末位判断器、偶数判断器；所述末位判断器用于判断时序电路中止时获取的串行数据线数据是否为末位；所述偶数判断器用于判断末位预定数量二进制数对应的十进制数是否为偶数；所述偶数分解模块用于在判定所述十进制数为偶数时，根据偶数分解表，将所述偶数拆解为预定数量奇质数之和；并将预定数量奇质数转化为对应的预定数量二进制数；所述缓存模块用于将所述偶数分解模块输出的二进制数及原始二进制数进行缓存；所述末位标志寄存器用于存储末位判断器输出的末位判断结果、偶数判断器输出的偶数判断结果及所述偶数分解模块拆解所述偶数的拆解位数。。关注公众号马克数据网