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一种高精度DDS发生器的信号处理方法

申请号: CN202311392320.1
申请人: 灿芯半导体(成都)有限公司
申请日期: 2023/10/25

摘要文本

本发明公开了一种高精度DDS发生器的信号处理方法,涉及DDS发生器技术领域,其技术方案要点包括如下计算步骤:以中频信号采样率fs为累加器的工作频率,对控制字Fcw进行累加运算,并在每个运算周期,将累加值∑Fcw与fs进行比较,若∑Fcw≥fs则令∑Fcw=∑Fcw‑fs,确保∑Fcw的值满足0≤∑Fcw≤fs‑1,这样可以利用正余弦函数的周期性,只计算(0, 2π)内的相位值。一种高精度DDS发生器的信号处理方法,效果是,通过分步计算得到输出信号,从而达到不占用ROM资源的效果,同时还具备移频精度高、信号杂散值低的特点,适用于无线电测试测量领域中,从而极大减少了对于ROM资源的占用,避免了正余弦量化长度对DDS移频精度和杂散的影响。

专利详细信息

项目 内容
专利名称 一种高精度DDS发生器的信号处理方法
专利类型 发明申请
申请号 CN202311392320.1
申请日 2023/10/25
公告号 CN117348685A
公开日 2024/1/5
IPC主分类号 G06F1/02
权利人 灿芯半导体(成都)有限公司
发明人 周同; 吴树伟; 庄志青; 胡红明; 张希鹏; 周玉镇
地址 四川省成都市中国(四川)自由贸易试验区成都高新区天府大道中段1366号E7座2栋5层7、8号

专利主权项内容

1.一种高精度DDS发生器的信号处理方法,其特征在于,包括如下计算步骤:以中频信号采样率f为累加器的工作频率,对控制字F进行累加运算,并在每个运算周期,将累加值∑F与f进行比较,若∑F≥f则令∑F=∑F-f,确保∑F的值满足0≤∑F≤f-1,这样可以利用正余弦函数的周期性,只计算(0, 2π)内的相位值;scwcwscwscwcwscwcws将∑F作为除数,f作为除数,送入除法器div,计算∑F/f,div基于cordic算法实现,参数配置如下:cwscwscordic div(N, f, ∑F, 0, ch, bit_num);scw其中N=22,代表除法运算迭代次数;f为信号采样率,本例取f=3.2MHz;∑F为控制字累加和;ch=3,配置div为线性系统模型;bit_num=22,代表除法的扩展位宽;sscw除法运算的输出结果为∑F/f·2^bit_num, 2^bit_num为除法运算中,浮点转定点的放大值。完成除法运算后,∑F/f·2^bit_num, 需要与2π进行乘法运算,以得到实时相位值,考虑到2π为浮点数,为保证运算精度,转定点过程中,需放大2^bit_num_2π,所以乘法运算后得到的相位值为:cwscwsfloor(∑F/f·2^bit_num)·floor(2π·2^bit_num_2π);cws其中,2^bit_num·2^bit_num_2π为除法运算和2π的定点化带来的放大增益。得到相位值后,通过第二级函数发生器trig得到正余弦值,trig基于cordic实现,参数配置如下:cordic trig(N, 0, 2^(bit_num+bit_num_2π), phase, ch, (bit_num+bit_num_2π));N=22,代表迭代次数,由于前级除法和乘法运算共带来了2^bit_num·2^bit_num_2π的放大增益,因此在基于圆周模型的cordic算法中,需要将这部分增益设置为初值,替换原来的初值1,phase代表相位值,为前级除法和乘法运算得到的floor(∑F/f·2^bit_num)·floor(2π·2^bit_num_2π);cwsch=2,配置trig为圆周系统模型。